Pileus Git - ~andy/linux/blob - drivers/bcma/driver_pci_host.c

   1 /*
   2  * Broadcom specific AMBA
   3  * PCI Core in hostmode
   4  *
   5  * Copyright 2005 - 2011, Broadcom Corporation
   6  * Copyright 2006, 2007, Michael Buesch <m@bues.ch>
   7  * Copyright 2011, 2012, Hauke Mehrtens <hauke@hauke-m.de>
   8  *
   9  * Licensed under the GNU/GPL. See COPYING for details.
  10  */
  11
  12 #include "bcma_private.h"
  13 #include <linux/pci.h>
  14 #include <linux/export.h>
  15 #include <linux/bcma/bcma.h>
  16 #include <asm/paccess.h>
  17
  18 /* Probe a 32bit value on the bus and catch bus exceptions.
  19  * Returns nonzero on a bus exception.
  20  * This is MIPS specific */
  21 #define mips_busprobe32(val, addr)      get_dbe((val), ((u32 *)(addr)))
  22
  23 /* Assume one-hot slot wiring */
  24 #define BCMA_PCI_SLOT_MAX       16
  25 #define PCI_CONFIG_SPACE_SIZE   256
  26
  27 bool __devinit bcma_core_pci_is_in_hostmode(struct bcma_drv_pci *pc)
  28 {
  29         struct bcma_bus *bus = pc->core->bus;
  30         u16 chipid_top;
  31         u32 tmp;
  32
  33         chipid_top = (bus->chipinfo.id & 0xFF00);
  34         if (chipid_top != 0x4700 &&
  35             chipid_top != 0x5300)
  36                 return false;
  37
  38         bcma_core_enable(pc->core, 0);
  39
  40         return !mips_busprobe32(tmp, pc->core->io_addr);
  41 }
  42
  43 static u32 bcma_pcie_read_config(struct bcma_drv_pci *pc, u32 address)
  44 {
  45         pcicore_write32(pc, BCMA_CORE_PCI_CONFIG_ADDR, address);
  46         pcicore_read32(pc, BCMA_CORE_PCI_CONFIG_ADDR);
  47         return pcicore_read32(pc, BCMA_CORE_PCI_CONFIG_DATA);
  48 }
  49
  50 static void bcma_pcie_write_config(struct bcma_drv_pci *pc, u32 address,
  51                                    u32 data)
  52 {
  53         pcicore_write32(pc, BCMA_CORE_PCI_CONFIG_ADDR, address);
  54         pcicore_read32(pc, BCMA_CORE_PCI_CONFIG_ADDR);
  55         pcicore_write32(pc, BCMA_CORE_PCI_CONFIG_DATA, data);
  56 }
  57
  58 static u32 bcma_get_cfgspace_addr(struct bcma_drv_pci *pc, unsigned int dev,
  59                              unsigned int func, unsigned int off)
  60 {
  61         u32 addr = 0;
  62
  63         /* Issue config commands only when the data link is up (atleast
  64          * one external pcie device is present).
  65          */
  66         if (dev >= 2 || !(bcma_pcie_read(pc, BCMA_CORE_PCI_DLLP_LSREG)
  67                           & BCMA_CORE_PCI_DLLP_LSREG_LINKUP))
  68                 goto out;
  69
  70         /* Type 0 transaction */
  71         /* Slide the PCI window to the appropriate slot */
  72         pcicore_write32(pc, BCMA_CORE_PCI_SBTOPCI1, BCMA_CORE_PCI_SBTOPCI_CFG0);
  73         /* Calculate the address */
  74         addr = pc->host_controller->host_cfg_addr;
  75         addr |= (dev << BCMA_CORE_PCI_CFG_SLOT_SHIFT);
  76         addr |= (func << BCMA_CORE_PCI_CFG_FUN_SHIFT);
  77         addr |= (off & ~3);
  78
  79 out:
  80         return addr;
  81 }
  82
  83 static int bcma_extpci_read_config(struct bcma_drv_pci *pc, unsigned int dev,
  84                                   unsigned int func, unsigned int off,
  85                                   void *buf, int len)
  86 {
  87         int err = -EINVAL;
  88         u32 addr, val;
  89         void __iomem *mmio = 0;
  90
  91         WARN_ON(!pc->hostmode);
  92         if (unlikely(len != 1 && len != 2 && len != 4))
  93                 goto out;
  94         if (dev == 0) {
  95                 /* we support only two functions on device 0 */
  96                 if (func > 1)
  97                         goto out;
  98
  99                 /* accesses to config registers with offsets >= 256
 100                  * requires indirect access.
 101                  */
 102                 if (off >= PCI_CONFIG_SPACE_SIZE) {
 103                         addr = (func << 12);
 104                         addr |= (off & 0x0FFC);
 105                         val = bcma_pcie_read_config(pc, addr);
 106                 } else {
 107                         addr = BCMA_CORE_PCI_PCICFG0;
 108                         addr |= (func << 8);
 109                         addr |= (off & 0xFC);
 110                         val = pcicore_read32(pc, addr);
 111                 }
 112         } else {
 113                 addr = bcma_get_cfgspace_addr(pc, dev, func, off);
 114                 if (unlikely(!addr))
 115                         goto out;
 116                 err = -ENOMEM;
 117                 mmio = ioremap_nocache(addr, sizeof(val));
 118                 if (!mmio)
 119                         goto out;
 120
 121                 if (mips_busprobe32(val, mmio)) {
 122                         val = 0xFFFFFFFF;
 123                         goto unmap;
 124                 }
 125         }
 126         val >>= (8 * (off & 3));
 127
 128         switch (len) {
 129         case 1:
 130                 *((u8 *)buf) = (u8)val;
 131                 break;
 132         case 2:
 133                 *((u16 *)buf) = (u16)val;
 134                 break;
 135         case 4:
 136                 *((u32 *)buf) = (u32)val;
 137                 break;
 138         }
 139         err = 0;
 140 unmap:
 141         if (mmio)
 142                 iounmap(mmio);
 143 out:
 144         return err;
 145 }
 146
 147 static int bcma_extpci_write_config(struct bcma_drv_pci *pc, unsigned int dev,
 148                                    unsigned int func, unsigned int off,
 149                                    const void *buf, int len)
 150 {
 151         int err = -EINVAL;
 152         u32 addr, val;
 153         void __iomem *mmio = 0;
 154         u16 chipid = pc->core->bus->chipinfo.id;
 155
 156         WARN_ON(!pc->hostmode);
 157         if (unlikely(len != 1 && len != 2 && len != 4))
 158                 goto out;
 159         if (dev == 0) {
 160                 /* we support only two functions on device 0 */
 161                 if (func > 1)
 162                         goto out;
 163
 164                 /* accesses to config registers with offsets >= 256
 165                  * requires indirect access.
 166                  */
 167                 if (off >= PCI_CONFIG_SPACE_SIZE) {
 168                         addr = (func << 12);
 169                         addr |= (off & 0x0FFC);
 170                         val = bcma_pcie_read_config(pc, addr);
 171                 } else {
 172                         addr = BCMA_CORE_PCI_PCICFG0;
 173                         addr |= (func << 8);
 174                         addr |= (off & 0xFC);
 175                         val = pcicore_read32(pc, addr);
 176                 }
 177         } else {
 178                 addr = bcma_get_cfgspace_addr(pc, dev, func, off);
 179                 if (unlikely(!addr))
 180                         goto out;
 181                 err = -ENOMEM;
 182                 mmio = ioremap_nocache(addr, sizeof(val));
 183                 if (!mmio)
 184                         goto out;
 185
 186                 if (mips_busprobe32(val, mmio)) {
 187                         val = 0xFFFFFFFF;
 188                         goto unmap;
 189                 }
 190         }
 191
 192         switch (len) {
 193         case 1:
 194                 val &= ~(0xFF << (8 * (off & 3)));
 195                 val |= *((const u8 *)buf) << (8 * (off & 3));
 196                 break;
 197         case 2:
 198                 val &= ~(0xFFFF << (8 * (off & 3)));
 199                 val |= *((const u16 *)buf) << (8 * (off & 3));
 200                 break;
 201         case 4:
 202                 val = *((const u32 *)buf);
 203                 break;
 204         }
 205         if (dev == 0) {
 206                 /* accesses to config registers with offsets >= 256
 207                  * requires indirect access.
 208                  */
 209                 if (off >= PCI_CONFIG_SPACE_SIZE)
 210                         bcma_pcie_write_config(pc, addr, val);
 211                 else
 212                         pcicore_write32(pc, addr, val);
 213         } else {
 214                 writel(val, mmio);
 215
 216                 if (chipid == BCMA_CHIP_ID_BCM4716 ||
 217                     chipid == BCMA_CHIP_ID_BCM4748)
 218                         readl(mmio);
 219         }
 220
 221         err = 0;
 222 unmap:
 223         if (mmio)
 224                 iounmap(mmio);
 225 out:
 226         return err;
 227 }
 228
 229 static int bcma_core_pci_hostmode_read_config(struct pci_bus *bus,
 230                                               unsigned int devfn,
 231                                               int reg, int size, u32 *val)
 232 {
 233         unsigned long flags;
 234         int err;
 235         struct bcma_drv_pci *pc;
 236         struct bcma_drv_pci_host *pc_host;
 237
 238         pc_host = container_of(bus->ops, struct bcma_drv_pci_host, pci_ops);
 239         pc = pc_host->pdev;
 240
 241         spin_lock_irqsave(&pc_host->cfgspace_lock, flags);
 242         err = bcma_extpci_read_config(pc, PCI_SLOT(devfn),
 243                                      PCI_FUNC(devfn), reg, val, size);
 244         spin_unlock_irqrestore(&pc_host->cfgspace_lock, flags);
 245
 246         return err ? PCIBIOS_DEVICE_NOT_FOUND : PCIBIOS_SUCCESSFUL;
 247 }
 248
 249 static int bcma_core_pci_hostmode_write_config(struct pci_bus *bus,
 250                                                unsigned int devfn,
 251                                                int reg, int size, u32 val)
 252 {
 253         unsigned long flags;
 254         int err;
 255         struct bcma_drv_pci *pc;
 256         struct bcma_drv_pci_host *pc_host;
 257
 258         pc_host = container_of(bus->ops, struct bcma_drv_pci_host, pci_ops);
 259         pc = pc_host->pdev;
 260
 261         spin_lock_irqsave(&pc_host->cfgspace_lock, flags);
 262         err = bcma_extpci_write_config(pc, PCI_SLOT(devfn),
 263                                       PCI_FUNC(devfn), reg, &val, size);
 264         spin_unlock_irqrestore(&pc_host->cfgspace_lock, flags);
 265
 266         return err ? PCIBIOS_DEVICE_NOT_FOUND : PCIBIOS_SUCCESSFUL;
 267 }
 268
 269 /* return cap_offset if requested capability exists in the PCI config space */
 270 static u8 __devinit bcma_find_pci_capability(struct bcma_drv_pci *pc,
 271                                              unsigned int dev,
 272                                              unsigned int func, u8 req_cap_id,
 273                                              unsigned char *buf, u32 *buflen)
 274 {
 275         u8 cap_id;
 276         u8 cap_ptr = 0;
 277         u32 bufsize;
 278         u8 byte_val;
 279
 280         /* check for Header type 0 */
 281         bcma_extpci_read_config(pc, dev, func, PCI_HEADER_TYPE, &byte_val,
 282                                 sizeof(u8));
 283         if ((byte_val & 0x7F) != PCI_HEADER_TYPE_NORMAL)
 284                 return cap_ptr;
 285
 286         /* check if the capability pointer field exists */
 287         bcma_extpci_read_config(pc, dev, func, PCI_STATUS, &byte_val,
 288                                 sizeof(u8));
 289         if (!(byte_val & PCI_STATUS_CAP_LIST))
 290                 return cap_ptr;
 291
 292         /* check if the capability pointer is 0x00 */
 293         bcma_extpci_read_config(pc, dev, func, PCI_CAPABILITY_LIST, &cap_ptr,
 294                                 sizeof(u8));
 295         if (cap_ptr == 0x00)
 296                 return cap_ptr;
 297
 298         /* loop thr'u the capability list and see if the requested capabilty
 299          * exists */
 300         bcma_extpci_read_config(pc, dev, func, cap_ptr, &cap_id, sizeof(u8));
 301         while (cap_id != req_cap_id) {
 302                 bcma_extpci_read_config(pc, dev, func, cap_ptr + 1, &cap_ptr,
 303                                         sizeof(u8));
 304                 if (cap_ptr == 0x00)
 305                         return cap_ptr;
 306                 bcma_extpci_read_config(pc, dev, func, cap_ptr, &cap_id,
 307                                         sizeof(u8));
 308         }
 309
 310         /* found the caller requested capability */
 311         if ((buf != NULL) && (buflen != NULL)) {
 312                 u8 cap_data;
 313
 314                 bufsize = *buflen;
 315                 if (!bufsize)
 316                         return cap_ptr;
 317
 318                 *buflen = 0;
 319
 320                 /* copy the cpability data excluding cap ID and next ptr */
 321                 cap_data = cap_ptr + 2;
 322                 if ((bufsize + cap_data)  > PCI_CONFIG_SPACE_SIZE)
 323                         bufsize = PCI_CONFIG_SPACE_SIZE - cap_data;
 324                 *buflen = bufsize;
 325                 while (bufsize--) {
 326                         bcma_extpci_read_config(pc, dev, func, cap_data, buf,
 327                                                 sizeof(u8));
 328                         cap_data++;
 329                         buf++;
 330                 }
 331         }
 332
 333         return cap_ptr;
 334 }
 335
 336 /* If the root port is capable of returning Config Request
 337  * Retry Status (CRS) Completion Status to software then
 338  * enable the feature.
 339  */
 340 static void __devinit bcma_core_pci_enable_crs(struct bcma_drv_pci *pc)
 341 {
 342         struct bcma_bus *bus = pc->core->bus;
 343         u8 cap_ptr, root_ctrl, root_cap, dev;
 344         u16 val16;
 345         int i;
 346
 347         cap_ptr = bcma_find_pci_capability(pc, 0, 0, PCI_CAP_ID_EXP, NULL,
 348                                            NULL);
 349         root_cap = cap_ptr + PCI_EXP_RTCAP;
 350         bcma_extpci_read_config(pc, 0, 0, root_cap, &val16, sizeof(u16));
 351         if (val16 & BCMA_CORE_PCI_RC_CRS_VISIBILITY) {
 352                 /* Enable CRS software visibility */
 353                 root_ctrl = cap_ptr + PCI_EXP_RTCTL;
 354                 val16 = PCI_EXP_RTCTL_CRSSVE;
 355                 bcma_extpci_read_config(pc, 0, 0, root_ctrl, &val16,
 356                                         sizeof(u16));
 357
 358                 /* Initiate a configuration request to read the vendor id
 359                  * field of the device function's config space header after
 360                  * 100 ms wait time from the end of Reset. If the device is
 361                  * not done with its internal initialization, it must at
 362                  * least return a completion TLP, with a completion status
 363                  * of "Configuration Request Retry Status (CRS)". The root
 364                  * complex must complete the request to the host by returning
 365                  * a read-data value of 0001h for the Vendor ID field and
 366                  * all 1s for any additional bytes included in the request.
 367                  * Poll using the config reads for max wait time of 1 sec or
 368                  * until we receive the successful completion status. Repeat
 369                  * the procedure for all the devices.
 370                  */
 371                 for (dev = 1; dev < BCMA_PCI_SLOT_MAX; dev++) {
 372                         for (i = 0; i < 100000; i++) {
 373                                 bcma_extpci_read_config(pc, dev, 0,
 374                                                         PCI_VENDOR_ID, &val16,
 375                                                         sizeof(val16));
 376                                 if (val16 != 0x1)
 377                                         break;
 378                                 udelay(10);
 379                         }
 380                         if (val16 == 0x1)
 381                                 bcma_err(bus, "PCI: Broken device in slot %d\n",
 382                                          dev);
 383                 }
 384         }
 385 }
 386
 387 void __devinit bcma_core_pci_hostmode_init(struct bcma_drv_pci *pc)
 388 {
 389         struct bcma_bus *bus = pc->core->bus;
 390         struct bcma_drv_pci_host *pc_host;
 391         u32 tmp;
 392         u32 pci_membase_1G;
 393         unsigned long io_map_base;
 394
 395         bcma_info(bus, "PCIEcore in host mode found\n");
 396
 397         if (bus->sprom.boardflags_lo & BCMA_CORE_PCI_BFL_NOPCI) {
 398                 bcma_info(bus, "This PCIE core is disabled and not working\n");
 399                 return;
 400         }
 401
 402         pc_host = kzalloc(sizeof(*pc_host), GFP_KERNEL);
 403         if (!pc_host)  {
 404                 bcma_err(bus, "can not allocate memory");
 405                 return;
 406         }
 407
 408         spin_lock_init(&pc_host->cfgspace_lock);
 409
 410         pc->host_controller = pc_host;
 411         pc_host->pci_controller.io_resource = &pc_host->io_resource;
 412         pc_host->pci_controller.mem_resource = &pc_host->mem_resource;
 413         pc_host->pci_controller.pci_ops = &pc_host->pci_ops;
 414         pc_host->pdev = pc;
 415
 416         pci_membase_1G = BCMA_SOC_PCI_DMA;
 417         pc_host->host_cfg_addr = BCMA_SOC_PCI_CFG;
 418
 419         pc_host->pci_ops.read = bcma_core_pci_hostmode_read_config;
 420         pc_host->pci_ops.write = bcma_core_pci_hostmode_write_config;
 421
 422         pc_host->mem_resource.name = "BCMA PCIcore external memory",
 423         pc_host->mem_resource.start = BCMA_SOC_PCI_DMA;
 424         pc_host->mem_resource.end = BCMA_SOC_PCI_DMA + BCMA_SOC_PCI_DMA_SZ - 1;
 425         pc_host->mem_resource.flags = IORESOURCE_MEM | IORESOURCE_PCI_FIXED;
 426
 427         pc_host->io_resource.name = "BCMA PCIcore external I/O",
 428         pc_host->io_resource.start = 0x100;
 429         pc_host->io_resource.end = 0x7FF;
 430         pc_host->io_resource.flags = IORESOURCE_IO | IORESOURCE_PCI_FIXED;
 431
 432         /* Reset RC */
 433         usleep_range(3000, 5000);
 434         pcicore_write32(pc, BCMA_CORE_PCI_CTL, BCMA_CORE_PCI_CTL_RST_OE);
 435         msleep(50);
 436         pcicore_write32(pc, BCMA_CORE_PCI_CTL, BCMA_CORE_PCI_CTL_RST |
 437                         BCMA_CORE_PCI_CTL_RST_OE);
 438
 439         /* 64 MB I/O access window. On 4716, use
 440          * sbtopcie0 to access the device registers. We
 441          * can't use address match 2 (1 GB window) region
 442          * as mips can't generate 64-bit address on the
 443          * backplane.
 444          */
 445         if (bus->chipinfo.id == BCMA_CHIP_ID_BCM4716 ||
 446             bus->chipinfo.id == BCMA_CHIP_ID_BCM4748) {
 447                 pc_host->mem_resource.start = BCMA_SOC_PCI_MEM;
 448                 pc_host->mem_resource.end = BCMA_SOC_PCI_MEM +
 449                                             BCMA_SOC_PCI_MEM_SZ - 1;
 450                 pcicore_write32(pc, BCMA_CORE_PCI_SBTOPCI0,
 451                                 BCMA_CORE_PCI_SBTOPCI_MEM | BCMA_SOC_PCI_MEM);
 452         } else if (bus->chipinfo.id == BCMA_CHIP_ID_BCM4706) {
 453                 tmp = BCMA_CORE_PCI_SBTOPCI_MEM;
 454                 tmp |= BCMA_CORE_PCI_SBTOPCI_PREF;
 455                 tmp |= BCMA_CORE_PCI_SBTOPCI_BURST;
 456                 if (pc->core->core_unit == 0) {
 457                         pc_host->mem_resource.start = BCMA_SOC_PCI_MEM;
 458                         pc_host->mem_resource.end = BCMA_SOC_PCI_MEM +
 459                                                     BCMA_SOC_PCI_MEM_SZ - 1;
 460                         pc_host->io_resource.start = 0x100;
 461                         pc_host->io_resource.end = 0x47F;
 462                         pci_membase_1G = BCMA_SOC_PCIE_DMA_H32;
 463                         pcicore_write32(pc, BCMA_CORE_PCI_SBTOPCI0,
 464                                         tmp | BCMA_SOC_PCI_MEM);
 465                 } else if (pc->core->core_unit == 1) {
 466                         pc_host->mem_resource.start = BCMA_SOC_PCI1_MEM;
 467                         pc_host->mem_resource.end = BCMA_SOC_PCI1_MEM +
 468                                                     BCMA_SOC_PCI_MEM_SZ - 1;
 469                         pc_host->io_resource.start = 0x480;
 470                         pc_host->io_resource.end = 0x7FF;
 471                         pci_membase_1G = BCMA_SOC_PCIE1_DMA_H32;
 472                         pc_host->host_cfg_addr = BCMA_SOC_PCI1_CFG;
 473                         pcicore_write32(pc, BCMA_CORE_PCI_SBTOPCI0,
 474                                         tmp | BCMA_SOC_PCI1_MEM);
 475                 }
 476         } else
 477                 pcicore_write32(pc, BCMA_CORE_PCI_SBTOPCI0,
 478                                 BCMA_CORE_PCI_SBTOPCI_IO);
 479
 480         /* 64 MB configuration access window */
 481         pcicore_write32(pc, BCMA_CORE_PCI_SBTOPCI1, BCMA_CORE_PCI_SBTOPCI_CFG0);
 482
 483         /* 1 GB memory access window */
 484         pcicore_write32(pc, BCMA_CORE_PCI_SBTOPCI2,
 485                         BCMA_CORE_PCI_SBTOPCI_MEM | pci_membase_1G);
 486
 487
 488         /* As per PCI Express Base Spec 1.1 we need to wait for
 489          * at least 100 ms from the end of a reset (cold/warm/hot)
 490          * before issuing configuration requests to PCI Express
 491          * devices.
 492          */
 493         msleep(100);
 494
 495         bcma_core_pci_enable_crs(pc);
 496
 497         if (bus->chipinfo.id == BCMA_CHIP_ID_BCM4706 ||
 498             bus->chipinfo.id == BCMA_CHIP_ID_BCM4716) {
 499                 u16 val16;
 500                 bcma_extpci_read_config(pc, 0, 0, BCMA_CORE_PCI_CFG_DEVCTRL,
 501                                         &val16, sizeof(val16));
 502                 val16 |= (2 << 5);      /* Max payload size of 512 */
 503                 val16 |= (2 << 12);     /* MRRS 512 */
 504                 bcma_extpci_write_config(pc, 0, 0, BCMA_CORE_PCI_CFG_DEVCTRL,
 505                                          &val16, sizeof(val16));
 506         }
 507
 508         /* Enable PCI bridge BAR0 memory & master access */
 509         tmp = PCI_COMMAND_MASTER | PCI_COMMAND_MEMORY;
 510         bcma_extpci_write_config(pc, 0, 0, PCI_COMMAND, &tmp, sizeof(tmp));
 511
 512         /* Enable PCI interrupts */
 513         pcicore_write32(pc, BCMA_CORE_PCI_IMASK, BCMA_CORE_PCI_IMASK_INTA);
 514
 515         /* Ok, ready to run, register it to the system.
 516          * The following needs change, if we want to port hostmode
 517          * to non-MIPS platform. */
 518         io_map_base = (unsigned long)ioremap_nocache(pc_host->mem_resource.start,
 519                                                      resource_size(&pc_host->mem_resource));
 520         pc_host->pci_controller.io_map_base = io_map_base;
 521         set_io_port_base(pc_host->pci_controller.io_map_base);
 522         /* Give some time to the PCI controller to configure itself with the new
 523          * values. Not waiting at this point causes crashes of the machine. */
 524         usleep_range(10000, 15000);
 525         register_pci_controller(&pc_host->pci_controller);
 526         return;
 527 }
 528
 529 /* Early PCI fixup for a device on the PCI-core bridge. */
 530 static void bcma_core_pci_fixup_pcibridge(struct pci_dev *dev)
 531 {
 532         if (dev->bus->ops->read != bcma_core_pci_hostmode_read_config) {
 533                 /* This is not a device on the PCI-core bridge. */
 534                 return;
 535         }
 536         if (PCI_SLOT(dev->devfn) != 0)
 537                 return;
 538
 539         pr_info("PCI: Fixing up bridge %s\n", pci_name(dev));
 540
 541         /* Enable PCI bridge bus mastering and memory space */
 542         pci_set_master(dev);
 543         if (pcibios_enable_device(dev, ~0) < 0) {
 544                 pr_err("PCI: BCMA bridge enable failed\n");
 545                 return;
 546         }
 547
 548         /* Enable PCI bridge BAR1 prefetch and burst */
 549         pci_write_config_dword(dev, BCMA_PCI_BAR1_CONTROL, 3);
 550 }
 551 DECLARE_PCI_FIXUP_EARLY(PCI_ANY_ID, PCI_ANY_ID, bcma_core_pci_fixup_pcibridge);
 552
 553 /* Early PCI fixup for all PCI-cores to set the correct memory address. */
 554 static void bcma_core_pci_fixup_addresses(struct pci_dev *dev)
 555 {
 556         struct resource *res;
 557         int pos, err;
 558
 559         if (dev->bus->ops->read != bcma_core_pci_hostmode_read_config) {
 560                 /* This is not a device on the PCI-core bridge. */
 561                 return;
 562         }
 563         if (PCI_SLOT(dev->devfn) == 0)
 564                 return;
 565
 566         pr_info("PCI: Fixing up addresses %s\n", pci_name(dev));
 567
 568         for (pos = 0; pos < 6; pos++) {
 569                 res = &dev->resource[pos];
 570                 if (res->flags & (IORESOURCE_IO | IORESOURCE_MEM)) {
 571                         err = pci_assign_resource(dev, pos);
 572                         if (err)
 573                                 pr_err("PCI: Problem fixing up the addresses on %s\n",
 574                                        pci_name(dev));
 575                 }
 576         }
 577 }
 578 DECLARE_PCI_FIXUP_HEADER(PCI_ANY_ID, PCI_ANY_ID, bcma_core_pci_fixup_addresses);
 579
 580 /* This function is called when doing a pci_enable_device().
 581  * We must first check if the device is a device on the PCI-core bridge. */
 582 int bcma_core_pci_plat_dev_init(struct pci_dev *dev)
 583 {
 584         struct bcma_drv_pci_host *pc_host;
 585
 586         if (dev->bus->ops->read != bcma_core_pci_hostmode_read_config) {
 587                 /* This is not a device on the PCI-core bridge. */
 588                 return -ENODEV;
 589         }
 590         pc_host = container_of(dev->bus->ops, struct bcma_drv_pci_host,
 591                                pci_ops);
 592
 593         pr_info("PCI: Fixing up device %s\n", pci_name(dev));
 594
 595         /* Fix up interrupt lines */
 596         dev->irq = bcma_core_irq(pc_host->pdev->core);
 597         pci_write_config_byte(dev, PCI_INTERRUPT_LINE, dev->irq);
 598
 599         return 0;
 600 }
 601 EXPORT_SYMBOL(bcma_core_pci_plat_dev_init);
 602
 603 /* PCI device IRQ mapping. */
 604 int bcma_core_pci_pcibios_map_irq(const struct pci_dev *dev)
 605 {
 606         struct bcma_drv_pci_host *pc_host;
 607
 608         if (dev->bus->ops->read != bcma_core_pci_hostmode_read_config) {
 609                 /* This is not a device on the PCI-core bridge. */
 610                 return -ENODEV;
 611         }
 612
 613         pc_host = container_of(dev->bus->ops, struct bcma_drv_pci_host,
 614                                pci_ops);
 615         return bcma_core_irq(pc_host->pdev->core);
 616 }
 617 EXPORT_SYMBOL(bcma_core_pci_pcibios_map_irq);